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JPlace: A Clock-Aware Length-Matching Placement for Rapid Single-Flux-Quantum Circuits
会议论文
2024 DESIGN, AUTOMATION & TEST IN EUROPE CONFERENCE & EXHIBITION (DATE), Valencia, Spain, 25-27 March 2024
作者:
Siyan Chen
;
Rongliang Fu
;
Junying Huang
;
Zhimin Zhang
;
Xiaochun Ye
Adobe PDF(654Kb)
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浏览/下载：218/0
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提交时间：2024/06/17
Alignment
Computation theory
Computer circuits
Computing power
Dynamic programming
Heuristic methods
Timing circuits
Computing technology
Length matching
Low-power consumption
Placement
Rapid single flux quantum circuits
Rapid single-flux quantum logic
Rapid single-flux-quantum
Superconducting logic
Timing alignment
Wire length
JRouter: A Multi-Terminal Hierarchical Length-Matching Router under Planar Manhattan Routing Model for RSFQ Circuits
会议论文
PROCEEDINGS OF THE ACM GREAT LAKES SYMPOSIUM ON VLSI, GLSVLSI, Knoxville, TN, United states, June 5, 2023 - June 7, 2023
作者:
Chen, Xinda
;
Fu, Rongliang
;
Huang, Junying
;
Cao, Huawei
;
Zhang, Zhimin
Adobe PDF(1863Kb)
|
收藏
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浏览/下载：337/0
|
提交时间：2023/07/14
Computation theory
Computer circuits
Energy efficiency
Timing circuits
Length matching
Manhattan routing
Multi terminals
Rapid single flux quantum circuits
Rapid single-flux quantum logic
Rapid single-flux-quantum
Routing model
Routings
Rsfq
Superconducting logic
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